ELETRONICA DIGITAL V

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11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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ELETRONICA DIGITAL ( https://www.tecconcursos.com.br/s/Q152GX )
Engenharia Elétrica e Eletrônica
Questão 801: CESGRANRIO - Eng (LIQUIGÁS)/LIQUIGÁS/Júnior/Elétrica/2014
Assunto: Latches e flip-Flop´s
Motivado pela Copa do Mundo de 2014, um torcedor decidiu montar um letreiro luminoso com as três primeiras letras do nome de nosso país: BRA. Nesse letreiro, o
acendimento de cada letra é comandado pelo circuito digital sequencial ilustrado a seguir.
 
 
Esse circuito foi projetado de modo que uma determinada letra acenderá somente quando o seu respectivo sinal de comando digital assumir um nível lógico alto.
O objetivo desse circuito é fazer com que as letras acendam e apaguem, repetindo a ordem mostrada pelo diagrama apresentado. Nessa sequência, as três começam
apagadas, e, depois, as letras vão acendendo uma a uma até que todas estejam acesas ao final da sequência.
Para realizar a sequência de acendimento desejada, o circuito combinacional deve produzir os sinais de comando dos flip-flops tipo D, através do seguinte par de funções
lógicas:
 a) 
 
.
 
 b) 
 
.
 
 c) 
 
.
 
 d) 
 
.
 
 e) 
 
.
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Questão 802: FGV - Ana San (COMPESA)/COMPESA/Engenheiro Eletrônico/2014
Assunto: Latches e flip-Flop´s
Considere a seguinte máquina de estados BA e sua implementação, de forma síncrona, utilizando flip-flops JK.
 
{ = +D1 Q1Q2 Q1
¯ Q2
¯
=D2 Q2
¯
{ = +D1 Q1Q1
¯ Q1¯ Q2
=D2 Q2¯
{ =D1 Q2
¯
=D2 Q1
{ =D1 Q1
¯
=D2 Q2
{ =D1 Q2
=D2 Q1¯
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Os sinais JBKB e JAKA que, respectivamente, geram os estados de B e A, são
 a) 11 e 00
 b) 01 e AB
 c) AA E BB
 d) AA e 00
 e) 11 e BB
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Questão 803: CONSULPLAN - TIN (CBTU)/CBTU/Eletrônica/2014
Assunto: Latches e flip-Flop´s
O circuito a seguir foi desenvolvido com intuito de ligar e desligar um relé através da saída Q do FF (Flip-Flop) para acionar um motor AC. Ao energizar o relé em nível
lógico alto, o motor é acionado e, ao desenergizar o relé nível lógico 0, o motor é desacionado. Inicialmente, a saída Q está em nível lógico 0.
 
 
Assinale a alternativa que melhor descreve corretamente o funcionamento do circuito.
 a) Sem a presença de luz o motor é acionado. 
 b) Com a presença de luz o motor é acionado.
 c) Sem a presença de luz o motor é desacionado.
 d) Com a presença de luz o motor é desacionado.
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Questão 804: COPERVE-UFSC - Tec (UFSC)/UFSC/Eletrônica/2014
Assunto: Latches e flip-Flop´s
Ao se desenvolverem circuitos sujeitos a diversos domínios de sinais de clock (multiple clock designs) para FPGAs, o projetista que utiliza linguagens de descrição de
hardware precisa tomar alguns cuidados em relação ao problema da metaestabilidade. Assinale a alternativa que apresenta a resposta CORRETA em relação a possíveis
soluções para o problema da metaestabilidade em FPGAs, resultante da transferência de dados entre circuitos alimentados por diferentes domínios de clock.
 a) Deve-se desenvolver um circuito completamente assíncrono, sem troca de dados entre diferentes domínios de clock.
 b) Devem-se utilizar flip-flops para gerar um atraso no fluxo de dados entre os diferentes domínios de clock. O atraso precisa ser calculado considerando-se uma
duração suficiente até que o comportamento metaestável seja removido.
 c) Devem-se utilizar multiplexadores entre os blocos sujeitos a diferentes domínios de clock, possibilitando assim a transferência síncrona dos dados.
 d) Devem-se utilizar circuitos combinacionais para realizar a transferência de dados síncrona entre os blocos sujeitos a diferentes domínios de clock.
 e) Deve-se utilizar uma memória compartilhada entre os circuitos sujeitos a diferentes domínios de clock. Essa memória deverá utilizar o mesmo sinal de relógio do
circuito que possuir o clock mais rápido.
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Questão 805: SSOA - Tec (UNILAB)/UNILAB/Eletroeletrônica/2014
Assunto: Latches e flip-Flop´s
Um flip-flop J–K é uma importante unidade lógica, já que, a partir dela, é possível elaborar e construir uma elevada gama de circuitos lógicos, com as mais diversas
funções, podendo-se afirmar que, quando suas entradas J e K são iguais a zero, na presença de um pulso de clock, ocorrerá permuta dos estados das suas saídas (Q e Q̅
).
 Certo
 Errado
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Questão 806: FAURGS - Tec (UFRGS)/UFRGS/Eletrônica/2013
Assunto: Latches e flip-Flop´s
No circuito abaixo, com componentes ideais, considere que as saídas dos Flip-Flops (Q no nó “5” para o Flip-Flop 1 e Q no nó “7” para o Flip-Flop 2) estão em zero lógico
antes de ser aplicado o sinal de relógio no nó “3”.
 
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Assinale a alternativa que apresenta os valores assumidos a cada pulso do relógio pelas saídas “5” e “7”, respectivamente, após o início da aplicação do relógio.
 a) 00, 01, 10, 11, 00, 01, 10, 11...
 b) 00, 01, 11, 00, 00, 01, 11, 00...
 c) 00, 11, 01, 10, 00, 11, 01, 10...
 d) 10, 11, 01, 00, 10, 11, 01, 00...
 e) 11, 01, 10, 00, 11, 01, 10, 00...
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Questão 807: IBFC - PEB (SEDF)/SEDF/Eletrônica e Eletrotécnica/2013
Assunto: Latches e flip-Flop´s
A montagem abaixo pode ser relacionada a:
 
 
 a) Um Monoestável Síncrono tipo D.
 b) Um Monoestável Síncrono tipo T.
 c) Um Astável JKcom portas NAND.
 d) Um Flip -flop RS Sincronizado.
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Questão 808: IADES - Eng (SUDAM)/SUDAM/Engenharia Elétrica/2013
Assunto: Latches e flip-Flop´s
Em relação aos sistemas digitais, assinale a alternativa incorreta.
 a) O circuito sequencial assíncrono depende da ordem segundo a qual as entradas mudam e o estado do circuito pode se alterar a qualquer tempo, como
consequência de uma mudança de suas entradas.
 b) O circuito sequencial síncrono utiliza um sinal denominado relógio, que tem a função de cadenciar uma eventual troca de estado; a forma de onda de um sinal é
dita como variável.
 c) Em um circuito sequencial síncrono, conforme o tipo de circuito utilizado como elemento de memória, esta amostragem das entradas pode ser sincronizada pela
borda ascendente ou pela borda descendente do relógio.
 d) Um flip-flop é um circuito digital que possui duas entradas e duas saídas, e são os elementos de memória utilizados nos circuitos sequenciais síncronos.
 e) Latches são um tipo de flip-flops, operam por níveis dos sinais de entrada e servem como base na construção dos flip-flops mais sofisticados.
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Questão 809: COPEVE UFMG - Eng (UFMG)/UFMG/Eletricista/2013
Assunto: Latches e flip-Flop´s
Qual o número MÍNIMO de flip-flops do tipo JK necessário para se construir um contador síncrono crescente/decrescente, que seja capaz de contar os inteiros entre 0 e
10?
 a) 2
 b) 6
 c) 8
 d) 4
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Questão 810: CEBRASPE (CESPE) - Ana MPU/MPU/Perícia/Engenharia Elétrica/2013
Assunto: Latches e flip-Flop´s
Considerando as tecnologias e osprocessos envolvidos na construção e na utilização de dispositivos e circuitos eletrônicos, julgue o item a seguir.
 
As entradas PRESET e CLEAR de um flip-flop JK não podem assumir o valor zero simultaneamente. Já o flip-flop T é um JK que possui as entradas J e K curto-circuitadas.
 Certo
 Errado
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Questão 811: CEBRASPE (CESPE) - Per Crim (PO AL)/PO AL/Engenharia Elétrica, Eletrônica, Redes de Comunicação ou
Telecomunicações/2013
Assunto: Latches e flip-Flop´s
No que se refere às eletrônicas analógica, digital e de potência, julgue o item de subsequente.
 
O flip-flop JK é um flip-flop SR aprimorado, sem o uso de realimentação.
 
 Certo
 Errado
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Questão 812: IAUPE - Ass SG (COMPESA)/COMPESA/Técnico Operacional/Eletrônica/2013
Assunto: Latches e flip-Flop´s
Analise os itens abaixo:
 
I. O circuito sequencial assíncrono usa um relógio com o objetivo de trocar estados.
II. O circuito sequencial síncrono depende da muda de estado do circuito no tempo, como consequência da variação de sua entrada.
III. As fontes de energia usadas em circuitos sequenciais síncronos são chamadas de flip-flops.
 
Está INCORRETO o que se afirma em
 a) I, II e III.
 b) I e II, apenas.
 c) I e III, apenas.
 d) II e III, apenas.
 e) II, apenas.
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Questão 813: Com. Org. (IFSP) - Tec (IF SP)/IF SP/Laboratório/Eletrônica/2012
Assunto: Latches e flip-Flop´s
Dado o circuito a seguir, que utiliza um flip-flop JK (tabela da verdade vista a seguir), qual o valor da frequência da saída A?
 
 
 a) 100Hz.
 b) 200Hz.
 c) 500Hz.
 d) 10kHz.
 e) 50kHz.
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Questão 814: FUNRIO - ETEA (CEITEC)/CEITEC S.A./PCIANA/2012
Assunto: Latches e flip-Flop´s
A única diferença entre os flip-flops JK e RS, no que concerne ao seu funcionamento, consiste no fato de que
 a) para que o flip-flop JK somente mude seu estado na borda de descida da forma de onda CLK (clock) as entradas J e K devem estar em nível alto.
 b) para que o flip-flop JK somente mude seu estado na borda de subida da forma de onda CLK (clock) as entradas R e S devem estar em nível alto.
 c) para que o flip-flop JK somente mude seu estado na borda de subida da forma de onda CLK (clock) as entradas J e K devem estar em nível alto.
 d) para que o flip-flop JK somente mude seu estado na borda de subida da forma de onda CLK (clock) as entradas R e S devem estar em nível baixo.
 e) as mudanças de estado do flip-flop JK ocorrem somente na borda de subida da forma de onda CLK (clock).
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Questão 815: CEBRASPE (CESPE) - Per Crim (PEFOCE)/PEFOCE/Engenharia Eletrônica/2012
Assunto: Latches e flip-Flop´s
Acerca de circuitos digitais, julgue o item subsecutivo.
 
Se o estado atual da máquina de estado apresentada a seguir for X = 1 e Y = 0, então, após um ciclo completo do relógio, o estado será X = 0 e Y = 1.
 
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 Certo
 Errado
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Questão 816: FUNRIO - ETEA (CEITEC)/CEITEC S.A./PCIANA/2012
Assunto: Latches e flip-Flop´s
Quatro flip-flops JK estão conectados em cascata por suas saídas Q, com suas entradas J e K constantes em nível alto. Se a frequência de relógio no primeiro flip-flop é
de 400 kHz e se a entrada de relógio nos flip-flops é invertida, a frequência de saída é igual a
 a) 100 kHz.
 b) 50 kHz.
 c) 1,6 MHz.
 d) 800 kHz.
 e) 25 kHz.
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Questão 817: CPCC UFES - Tec (UFES)/UFES/Industrial/Laboratório/2012
Assunto: Latches e flip-Flop´s
Um técnico em eletrônica estava averiguando um circuito de um contador digital síncrono, TTL compatível, baseado em flip-flops tipo T (toggle) e excitado por um sinal
retangular de 1kHz na sua entrada de clock. Para isso, o técnico usou um osciloscópio digital duplo canal, com trigger na borda de subida dado pelo canal A, canal este
sempre usado pelo técnico durante o experimento (o técnico não utilizou o segundo canal). O técnico selecionou o flip-flop correspondente ao bit menos significativo do
contador e, com a ponta de prova do canal A, ora posta na saída Q de um flip-flop, ora posta na saída Q “negado” do mesmo flip-flop, o técnico observou sempre a
mesma forma de onda como mostrado na figura abaixo. Portanto, de acordo com as alternativas expostas, é CORRETO concluir que:
 
 
 a) A saída Q está funcionando corretamente, mas a saída Q “negado” está em alta impedância, pois deveria ser observada uma forma invertida.
 b) A saída Q “negado” está funcionando corretamente, mas a saída Q está em alta impedância.
 c) Tanto o circuito quanto o osciloscópio, aparentemente, operam corretamente.
 d) O circuito opera corretamente, mas o osciloscópio apresenta problema de medição, pois as saídas Q e “Q negado” deveriam gerar formas de ondas invertidas.
 e) Tanto a saída Q como a Q “negado” estão em alta impedância.
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Questão 818: COPERVE-UFSC - Tec (UFSC)/UFSC/Eletrônica/2012
Assunto: Latches e flip-Flop´s
Assinale a alternativa que preenche CORRETAMENTE as lacunas abaixo.
Flip-flops e latches são circuitos digitais utilizados, entre outros, como elementos de memória para armazenar os estados de circuitos ____________. Os flip-flops e os
latches possuem uma entrada (sinal de controle) utilizada por um circuito externo para iniciar o processo de armazenamento da informação no componente. A principal
diferença entre esses componentes é que no ____________ o sinal de controle é sensível ao nível (zero ou um), enquanto que no ____________ o sinal de controle é
sensível à borda (de subida ou de descida).
 a) combinacionais – latch – flip-flop
 b) sequenciais – latch – flip-flop
 c) analógicos – flip-flop – latch
 d) sequenciais – flip-flop – latch
 e) combinacionais – flip-flop – latch
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Questão 819: CCC IFCE - Tec (IF CE)/IF CE/Laboratório/Industria/2012
Assunto: Latches e flip-Flop´s
Sobre os Flip-Flops SR (ou SC), JK e D, é incorreto afirmar-se que
 a) todos os flip-flops citados acima podem ser acionados, tanto na borda de subida, quanto na borda de descida.
 b) quando as entradas J e K do flip-flop JK estiverem, simultaneamente, em ALTO, na ocorrência de borda de acionamento do clock, a saída muda de estado
(comuta), seja ele qual for. para o complemento.
 c) no flip-flop SR, a combinação S = R = 1 não pode ocorrer simultaneamente a uma borda de acionamento do clock, por resultar em uma condição ambígua.
 d) no flip-flop D, a saída irá para o mesmo estado da entrada D, ao haver uma borda de acionamento do clock.
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 e) um flip-flop SR pode ser implementado com um flip-flop JK, conectando a entrada J à entrada K, através de uma porta inversora.
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Questão 820: CESGRANRIO - Tec (PETRO)/PETROBRAS/Manutenção Júnior/Eletrônica/2012
Assunto: Latches e flip-Flop´s
 
O circuitomostrado na figura funciona como um flip-flop
 a) RS com A≡R e B≡S
 b) RS com A≡S’ e B≡R’
 c) RS com A≡S e B≡R
 d) JK com A≡J e B≡K
 e) JK com A≡K e B≡J
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Questão 821: CEBRASPE (CESPE) - TJ STJ/STJ/Apoio Especializado/Telecomunicações/2012
Assunto: Latches e flip-Flop´s
Julgue o próximo item, acerca de eletricidade e eletrônica analógica e digital.
Considere um flip-flop do tipo JK, cujo diagrama está mostrado na figura I abaixo, em que o estado inicial é Q = 1 e em cujas entradas foram aplicados os sinais J e K,
mostrados na figura II. Nessas condições, os sinais nas saídas Q e do flip-flop serão aqueles mostrados na figura II.
 Certo
 Errado
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Questão 822: FUNRIO - ETEA (CEITEC)/CEITEC S.A./PRANBA/2012
Assunto: Latches e flip-Flop´s
Um flip-flop JK com J = 1 e K =1 recebe na entrada um relógio de 150 kHz. A saída Q é igual a
 a) 1 (nível lógico alto constante).
 b) uma onda quadrada de 75 kHz.
 c) 0 (nível lógico baixo constante).
 d) uma onda quadrada de 150 kHz.
 e) uma onda quadrada de 300 kHz.
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Questão 823: FUNRIO - ETEA (CEITEC)/CEITEC S.A./PRDICO/2012
Assunto: Latches e flip-Flop´s
Uma máquina de estado finita, de 2 (dois) estados (A e B) e 3 (três) saídas (X, Y e Z), deverá ser construída de forma a atender ao diagrama de transição de estados a
seguir. Para tanto, serão utilizados 2 (dois) flip-flops tipo D, e um circuito de reset que garante que, ao serem ligados ambos os flip-flops estarão com suas saídas em
nível baixo. Para que a máquina de estado funcione corretamente, as funções lógicas de entrada dos flip-flops, E1 e E2, deverão ser, respectivamente,
 
Q
¯ ¯¯̄
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 a) 
 
.
 
 b) 
 
.
 
 c) 
 
.
 
 d) 
 
.
 
 e) 
 
.
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Questão 824: CESGRANRIO - Eng Jr (TRANSPETRO)/TRANSPETRO/Automação/2012
Assunto: Latches e flip-Flop´s
A programação de controladores de processos de automação em um ambiente industrial utiliza um sinal digital de 100 kHz de frequência aplicado à entrada do sistema
abaixo.
 
 
Nessas condições, a frequência do sinal de saída, em kHz, é
 a) 0
 b) 10
 c) 25
 d) 50
 e) 100
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Questão 825: FUNRIO - ETEA (CEITEC)/CEITEC S.A./PRDICO/2012
Assunto: Latches e flip-Flop´s
Ao flip-flop JK, disparado por borda de subida, são aplicados os sinais conforme a figura a seguir. Analisando-se o comportamento deste circuito, pode-se afirmar que nos
instantes de tempo marcados por T1, T2, T3 e T4, a saída Z apresentará, respectivamente, os níveis lógicos
A+B e AB
¯ ¯¯̄
e AA
¯ ¯¯̄
B
¯ ¯¯̄
e BA
¯ ¯¯̄
A
¯ ¯¯̄
e AB
¯ ¯¯̄
B
¯ ¯¯̄
e BB
¯ ¯¯̄
A
¯ ¯¯̄
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 a) baixo; baixo; alto; alto.
 b) baixo; alto; alto; baixo.
 c) alto; alto; baixo; baixo.
 d) alto; baixo; baixo; baixo.
 e) baixo; alto; baixo; alto.
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Questão 826: FCC - AJ TRF2/TRF 2/Apoio Especializado/Engenharia Eletrônica/2012
Assunto: Latches e flip-Flop´s
O manual do fabricante do circuito integrado TTL 74LS373, que é um latch de 8 bits, indica por meio da tabela de funções, que, quando a entrada output control
encontra-se em nível H, as saídas Q0 a Q7 dos flip-flops encontram-se no estado Z, isto é, em
 a) tri-state.
 b) open-colector.
 c) baixa impedância.
 d) nível alto.
 e) nível baixo.
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Questão 827: CEBRASPE (CESPE) - Ana MPU/MPU/Perícia/Engenharia Elétrica/2010
Assunto: Latches e flip-Flop´s
A figura acima mostra um circuito sequencial que usa flip-flops JK gatilhados por borda de descida, implementado com circuitos integrados com tecnologia TTL. Nesse
circuito, o relógio é um sinal TTL compatível com os circuitos integrados usados e o sinal X é um sinal de controle TTL que pode ter valor lógico 0 ou 1. Com relação a
esse circuito, julgue o item abaixo.
Se o sinal X estiver em nível lógico 0, então a sequência realizada pelos bits Q1Q0 será 00 01 11 10 00, e se repetirá de forma cíclica.
 Certo
 Errado
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Questão 828: CEBRASPE (CESPE) - ATI (ABIN)/ABIN/Eletrônica/2010
Assunto: Latches e flip-Flop´s
As figuras I e II acima mostram dois circuitos sequenciais que utilizam flip-flops JK TTL gatilhados por borda de descida. Ambos os circuitos são acionados por um relógio
R, caracterizado por uma onda quadrada em nível TTL com frequência de 10 kHz. Com relação a esses circuitos, julgue o item a seguir.
O circuito sequencial da figura II é do tipo assíncrono.
 Certo
→ → → →
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 Errado
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Questão 829: CEBRASPE (CESPE) - ATI (ABIN)/ABIN/Eletrônica/2010
Assunto: Latches e flip-Flop´s
As figuras I e II acima mostram dois circuitos sequenciais que utilizam flip-flops JK TTL gatilhados por borda de descida. Ambos os circuitos são acionados por um relógio
R, caracterizado por uma onda quadrada em nível TTL com frequência de 10 kHz. Com relação a esses circuitos, julgue o item a seguir.
A saída Q do circuito na figura I corresponde a uma onda quadrada em nível TTL com frequência de 5 kHz.
 Certo
 Errado
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Questão 830: CEBRASPE (CESPE) - TJ (TRE BA)/TRE BA/Administrativa/Eletricidade e Telecomunicações/2010
Assunto: Latches e flip-Flop´s
Com relação a sistemas e dispositivos digitais, julgue o item seguinte.
 
No flip-flop JK do tipo mestre-escravo, se as entradas J e K estiverem todo o tempo conectadas ao nível lógico 1, então a saída Q, após sucessivos ciclos de relógio,
permanecerá no nível lógico 1.
 Certo
 Errado
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Questão 831: PUC PR - Tec (COPEL)/COPEL/Industrial/Eletrônica/2010
Assunto: Latches e flip-Flop´s
Considerando um flip-flop do tipo D, como ele deve ser configurado para operar como um flip-flop tipo T?
 a) A entrada de dados D deve ser ligada à saída Q (Saída Q).
 b) A entrada de dados D deve ser ligada ao nível lógico 1.
 c) A entrada de dados D deve ser ligada ao nível lógico 0.
 d) O Flip-Flop D não opera como um Flip-Flop tipo T.
 e) A entrada de dados D deve ser ligada à saída Q/ (Saída Q invertido).
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Questão 832: CEBRASPE (CESPE) - ATI (ABIN)/ABIN/Eletrônica/2010
Assunto: Latches e flip-Flop´s
As figuras I e II acima mostram dois circuitos sequenciais que utilizam flip-flops JK TTL gatilhados por borda de descida. Ambos os circuitos são acionados por um relógio
R, caracterizado por uma onda quadrada em nível TTL com frequência de 10 kHz. Com relação a esses circuitos, julgue o item a seguir.
Se, no circuito da figura II, o estado inicial das saídas Q1 e Q0 for Q1Q0 = 01, então a sequência que esses dois bits deverão percorrer é 01, 10, 01, 10, ..., com o ciclo se
repetindo indefinidamente.
 Certo
 Errado
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Questão 833: PUC PR - Tec (COPEL)/COPEL/Industrial/Eletrônica/2010
Assunto: Latches e flip-Flop´s
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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Nos circuitos flip-flops, encontram-se dois tipos de entradas, as sincronizadas e as assíncronas. Qual alternativa apresenta as entradas assíncronas nos flip-flops D e JK?
 a) D,J,K,CLK, PRESET, CLEAR.
 b) J,K,CLK, PRESET, CLEAR.
 c) PRESET, CLEAR.
 d) CLK, PRESET, CLEAR.
 e) D,J,K.
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Questão 834: CEBRASPE (CESPE) - Ana Tran (DETRAN DF)/DETRAN DF/Engenheiro Eletricista/2009
Assunto: Latches e flip-Flop´s
 
A figura acima representa um flip-flop RS básico, construído a partir de portas NÃO-E (NE) e inversores. No circuito, as variáveis de entrada são S e R e Q representa a
saída anterior (Qa) à aplicação das entradas.
Considerando essas informações, julgue o item que se segue.
 
A situação quando S = 1 e R = 1 não poderá ser permitida na entrada, porque forçaria o flip-flop a assumir um estado de saída no qual Q teria que ser igual à saída
complementar .
 Certo
 Errado
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Questão 835: CEBRASPE (CESPE) - ERAC (ANAC)/ANAC/Área 1/2009
Assunto: Latches e flip-Flop´s
 
Um sistema digital, como o circuito mostrado na figura acima, resulta da combinação de dispositivos eletrônicos desenvolvidos especialmente com a finalidade de
manipular grandezas que representem informações no formato digital. Julgue o seguinte item, acerca do circuito mostrado na figura e de circuitos digitais.
 
A parte do circuito incluída dentro de um retângulo tracejado na figura acima consiste em um circuito sequencial, enquanto a parte restante do circuito consiste em um
circuito combinacional.
 Certo
 Errado
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Questão 836: CEBRASPE (CESPE) - AJ TRE GO/TRE GO/Apoio Especializado/Engenharia Elétrica/2009
Assunto: Latches e flip-Flop´s
 
Considerando o flip-flop tipo T mostrado na figura acima, o qual é obtido a partir de um flip-flop JK mestre-escravo com as entradas J e K colocadas em curto-circuito,
assinale a opção correta.
 a) Caso J e K assumam as posições 1 e zero, respectivamente, a entrada T não é possível.
 b) A entrada CK não tem nenhuma função no flip-flop tipo T, mas é essencial para o funcionamento adequado do flip-flop JK mestre-escravo.
Q
¯ ¯¯̄
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 c) Quando tanto J quanto K assumem a posição zero, nenhuma saída pode ser observada em Q.
 d) O flip-flop do tipo T é amplamente encontrado na saída de circuitos integrados comerciais, por ser muito utilizado como célula de contadores assíncronos.
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Questão 837: CEBRASPE (CESPE) - Ana Tran (DETRAN DF)/DETRAN DF/Engenheiro Eletricista/2009
Assunto: Latches e flip-Flop´s
 
A figura acima representa um flip-flop RS básico, construído a partir de portas NÃO-E (NE) e inversores. No circuito, as variáveis de entrada são S e R e Q representa a
saída anterior (Qa) à aplicação das entradas.
Considerando essas informações, julgue o item que se segue.
A saída que o flip-flop irá assumir (após a aplicação das entradas) depende somente das entradas S e R.
 Certo
 Errado
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Questão 838: CEBRASPE (CESPE) - AJ TRT17/TRT 17/Apoio Especializado/Engenharia Elétrica/2009
Assunto: Latches e flip-Flop´s
 
Considerando a figura acima, que mostra o diagrama lógico de uma célula de memória RAM construída a partir de flip-flop, julgue o item subsequente.
 
Caso a alimentação do circuito ilustrado pelo diagrama seja desligada, o flip-flop passará a um estado imprevisível, perdendo o estado atual.
 Certo
 Errado
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Questão 839: CEBRASPE (CESPE) - ERAC (ANAC)/ANAC/Área 1/2009
Assunto: Latches e flip-Flop´s
 
Um sistema digital, como o circuito mostrado na figura acima, resulta da combinação de dispositivos eletrônicos desenvolvidos especialmente com a finalidade de
manipular grandezas que representem informações no formato digital. Julgue o seguinte item, acerca do circuito mostrado na figura e de circuitos digitais.
 
Os flip-flops são circuitos com a característica de manter fixo o valor da sua saída, mesmo que algumas de suas entradas variem, trocando de valor somente quando
determinada entrada do circuito pulse momentaneamente. Essa característica torna o flip-flop um componente básico em circuitos de memória digital.
 Certo
 Errado
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Questão 840: CEBRASPE (CESPE) - AJ TRT17/TRT 17/Apoio Especializado/Engenharia Elétrica/2009
Assunto: Latches e flip-Flop´s
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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Considerando a figura acima, que mostra o diagrama lógico de uma célula de memória RAM construída a partir de flip-flop, julgue o item subsequente.
Esse diagrama lógico refere-se a uma célula de memória RAM estática de 4 bits.
 Certo
 Errado
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Questão 841: CPCC UFES - Tec (UFES)/UFES/Eletrotécnica/2009
Assunto: Latches e flip-Flop´s
Uma onda quadrada de freqüência f é aplicada à entrada de clock (CLK) de um Flip-Flop tipo T quando a entrada T está no nível lógico 1. Nessa situação, pode-se afirmar
que a freqüência do sinal na saída (Q) do flip-flop terá uma freqüência igual a:
 a) f
 b) f/2
 c) 2f
 d) f/4
 e) 4f
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Questão 842: CEBRASPE (CESPE) - ERAC (ANAC)/ANAC/Área 1/2009
Assunto: Latches e flip-Flop´s
 
Um sistema digital, como o circuito mostrado na figura acima, resulta da combinação de dispositivos eletrônicos desenvolvidos especialmente com a finalidade de
manipular grandezas que representem informações no formato digital. Julgue o seguinte item, acerca do circuito mostrado na figura e de circuitos digitais.
 
Após as devidas simplificações, o valor de Set no circuito acima é determinado pela seguinte expressão lógica.
 Certo
 Errado
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Questão 843: COPERVE-UFSC - Tec (UFSC)/UFSC/Eletrônica/2009
Assunto: Latches e flip-Flop´s
Observe as figuras A e B abaixo.
Set = ( . ) +A
¯ ¯¯̄
B
¯ ¯¯̄
C
¯ ¯¯̄
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Considerando que os sinais “CK” e “limpa” mostrados na figura A são aplicados no circuito digital da figura B, e considerando que o período de “CK” é muito
maior do que os tempos de retardo dos flip-flops do circuito da figura B, é CORRETO afirmar que no instante t5 o conteúdo dos flip-flops será: 
 a) Q0 = 1 / Q1 = 0 / Q2 = 1. 
 b) Q0 = 0 / Q1 = 0 / Q2 = 0. 
 c) Q0 = 1 / Q1 = 1 / Q2 = 0. 
 d) Q0 = 0 / Q1 = 0 / Q2 = 1. 
 e) Q0 = 1 / Q1 = 1 / Q2 = 1. 
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Questão 844: CEBRASPE (CESPE) - ERAC (ANAC)/ANAC/Área 1/2009
Assunto: Latches e flip-Flop´s
 
Um sistema digital, como o circuito mostrado na figuraacima, resulta da combinação de dispositivos eletrônicos desenvolvidos especialmente com a finalidade de
manipular grandezas que representem informações no formato digital. Julgue o seguinte item, acerca do circuito mostrado na figura e de circuitos digitais.
 
Parte do circuito mostrado na figura consiste em um circuito básico de flip-flop chamado latch, cuja tabela-verdade é a seguinte.
 
 Certo
 Errado
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Questão 845: CEBRASPE (CESPE) - AJ TRT5/TRT 5/Apoio Especializado/Engenharia Elétrica/2008
Assunto: Latches e flip-Flop´s
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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Com referência à figura acima, que mostra o esquema de um flip-flop D, julgue o item a seguir.
Se a variável D, na entrada, assumir o estado igual a 1, então S assumirá o estado 1 e R assumirá zero.
 Certo
 Errado
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Questão 846: CEBRASPE (CESPE) - AJ TRT5/TRT 5/Apoio Especializado/Engenharia Elétrica/2008
Assunto: Latches e flip-Flop´s
Com referência à figura acima, que mostra o esquema de um flip-flop D, julgue o item a seguir.
Caso D assuma o estado zero, essa situação provocará, na saída do flip-flop, o estado 1.
 Certo
 Errado
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Questão 847: PUC PR - Tec (COPEL)/COPEL/Industrial/Eletrônica/2008
Assunto: Latches e flip-Flop´s
Dado o circuito constituído por 5 flip-flops tipo JK, operando como divisores de freqüência onde é aplicado uma frequência de 360 kHz na entrada do primeiro flip-flop.
Indicar as freqüências nos pontos Q1, Q3, Q4, Q5.
 
 
 a) Q1=180kHz, Q3=45kHz, Q4=22,5kHz, Q5=11,25kHz
 b) Q1=180kHz, Q3=90kHz, Q4=45kHz, Q5=22,5kHz
 c) Q1=0Hz, Q3=45kHz, Q4=22,5kHz, Q5=11,25kHz
 d) Q1=180kHz, Q3=0Hz, Q4=0Hz, Q5=0Hz
 e) Q1=0Hz, Q3=90kHz, Q4=45kHz, Q5=22,5kHz
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Questão 848: CEBRASPE (CESPE) - AJ TRT5/TRT 5/Apoio Especializado/Engenharia Elétrica/2008
Assunto: Latches e flip-Flop´s
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 15/58
Com referência à figura acima, que mostra o esquema de um flip-flop D, julgue o item a seguir.
Os flip-flops D possuem a capacidade de memorizar dados aplicados na sua entrada.
 Certo
 Errado
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Questão 849: CEBRASPE (CESPE) - Of BM (CBM DF)/CBM DF/Complementar/Engenharia Mecatrônica/2007
Assunto: Latches e flip-Flop´s
O circuito abaixo é constituído por uma porta ou exclusivo, uma porta inversora e dois flip-flops tipo D (DFF), com entradas Di e saídas Ai (I = 0, 1), e corresponde ao
sinal de relógio, aplicado em ambos os flip-flops. A respeito desse circuito, julgue o item a seguir.
 
 
O circuito apresentado caracteriza-se por ser apenas combinacional.
 Certo
 Errado
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Questão 850: CEBRASPE (CESPE) - Of BM (CBM DF)/CBM DF/Complementar/Engenharia Mecatrônica/2007
Assunto: Latches e flip-Flop´s
O circuito abaixo é constituído por uma porta ou exclusivo, uma porta inversora e dois flip-flops tipo D (DFF), com entradas Di e saídas Ai (I = 0, 1), e corresponde ao
sinal de relógio, aplicado em ambos os flip-flops. A respeito desse circuito, julgue o item a seguir.
 
 
Para D0 = 1, após um período do sinal de relógio, tem-se que A0 = 1.
 Certo
 Errado
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Questão 851: CEBRASPE (CESPE) - Of BM (CBM DF)/CBM DF/Complementar/Engenharia Mecatrônica/2007
Assunto: Latches e flip-Flop´s
O circuito abaixo é constituído por uma porta ou exclusivo, uma porta inversora e dois flip-flops tipo D (DFF), com entradas Di e saídas Ai (I = 0, 1), e corresponde ao
sinal de relógio, aplicado em ambos os flip-flops. A respeito desse circuito, julgue o item a seguir.
 
Φ
Φ
Φ
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 16/58
 
Se, inicialmente, A1 = 0 e A0 = 1, então, após dois períodos de relógio, A1 = 0 e A0 = 0.
 Certo
 Errado
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Questão 852: CEBRASPE (CESPE) - Of BM (CBM DF)/CBM DF/Complementar/Engenharia Mecatrônica/2007
Assunto: Latches e flip-Flop´s
O circuito abaixo é constituído por uma porta ou exclusivo, uma porta inversora e dois flip-flops tipo D (DFF), com entradas Di e saídas Ai (I = 0, 1), e corresponde ao
sinal de relógio, aplicado em ambos os flip-flops. A respeito desse circuito, julgue o item a seguir.
 
 
Se A0 = 1 e A1 = 1, então D0 = 0 e D1 = 1.
 Certo
 Errado
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Questão 853: FCC - TJ (TRE PB)/TRE PB/Apoio Especializado/Eletrônica/2007
Assunto: Latches e flip-Flop´s
Um circuito integrado digital comercial é constituído basicamente de oito flip-flops tipo D com saídas em tri-state e serve para armazenar informações lógicas de 1 byte. O
nome desse circuito integrado na forma como é identificado em datasheets é
 a) BCD to 7-segment decoders.
 b) 8-input EXCLUSIVE-OR gate.
 c) Synchronous 4-bit binary counter.
 d) 3-state octal D-type latches.
 e) 8-bit demultiplexers.
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Questão 854: CEBRASPE (CESPE) - Of BM (CBM DF)/CBM DF/Complementar/Engenharia Mecatrônica/2007
Assunto: Latches e flip-Flop´s
O circuito abaixo é constituído por uma porta ou exclusivo, uma porta inversora e dois flip-flops tipo D (DFF), com entradas Di e saídas Ai (I = 0, 1), e corresponde ao
sinal de relógio, aplicado em ambos os flip-flops. A respeito desse circuito, julgue o item a seguir.
 
Φ
Φ
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 17/58
 
O circuito mostrado implementa um contador de 2 bits.
 Certo
 Errado
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Questão 855: COPEVE UFMG - Tec (UFMG)/UFMG/Eletroeletrônica/2019
Assunto: Contadores e registradores
Um motor de passo deve ser acionado com o controlador, gerando a tabela de estados seguinte, onde , , e são as saídas para as bobinas do motor:
 
Passo
1 1 0 0 0
2 1 1 0 0
3 0 1 0 0
4 0 1 1 0
5 0 0 1 0
6 0 0 1 1
7 0 0 0 1
8 1 0 0 1
 
 
Assinale a alternativa que identifica a estrutura típica do circuito do controlador:
 a) Mux/Seletor de dados.
 b) Registrador com entrada paralela e saída série.
 c) Driver em ponte H.
 d) Contador síncrono.
 
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Questão 856: IBFC - Eng (Pref C S Agost)/Pref C Sto Agostinho/Eletricista/2019
Assunto: Contadores e registradores
A capacidade de armazenar informações binárias por um período de tempo é uma função imprescindível para os sistemas digitais. Sobre o dispositivo responsável por tal
armazenamento em circuitos digitais, assinale a alternativa correta.
 a) Portas lógicas
 b) Comparador
 c) Multiplexador
 d) Registrador
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Questão 857: SUGEP - Tec (UFRPE)/UFRPE/Laboratório/Eletrônica/2019
Assunto: Contadores e registradores
Em uma indústria, um dos seus processos requer que um misturador de ingredientesrealize o seu trabalho por exatamente 2 minutos. Para controlar esse processo com
precisão, é utilizado um contador de 8 bits, que recebe um pulso quadrado de período igual a 1 segundo. Ao iniciar o processo, o contador é zerado e, ao final do tempo
de mistura, um sinal de parada é enviado. A figura abaixo ilustra essa operação.
 
B3 B2 B1 B0
B3 B2 B1 B0
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 18/58
 
Assinale a alternativa que representa a função do circuito que fornece o sinal de parada do processo S=1.
 a) 
 b) 
 c) 
 d) 
 e) 
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Questão 858: FUNDEP - Eng (Lagoa Santa)/Pref Lagoa Santa/Eletricista/2019
Assunto: Contadores e registradores
Analise o circuito a seguir.
 
 
Após análise desse circuito, a função implementada é de um
 a) contador assíncrono decádico.
 b) contador síncrono de módulo 6.
 c) decodificador de contadores síncronos.
 d) registrador de deslocamento.
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Questão 859: COPEVE UFMG - Tec (UFMG)/UFMG/Eletroeletrônica/2019
Assunto: Contadores e registradores
Analise a figura que mostra o diagrama interno do circuito integrado 74LS374:
 
S = C7 ⋅ C6 ⋅ C5 ⋅ C4
S = C5 ⋅ C4 ⋅ C3 ⋅ C2 ⋅ C1
S = ⋅ C5 ⋅ C4 ⋅ C3 ⋅C7
¯ ¯¯̄¯̄
C0
¯ ¯¯̄¯̄
S = C6 ⋅ C5 ⋅ C4 ⋅ C3
S = C6 ⋅ C5 ⋅ ⋅ C2 ⋅ C1C4
¯ ¯¯̄¯̄
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 19/58
 
A alternativa que indica a função lógica CORRETA do circuito é:
 a) Registrador de deslocamento com entrada paralela e saída paralela.
 b) Registrador de entrada paralela e saída paralela com coletor aberto.
 c) Registrador de entrada paralela e saída paralela com três estados.
 d) Contador de 8 bits síncrono com saída em coletor aberto.
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Questão 860: NC-UFPR - Prof NU Jr (ITAIPU)/ITAIPU/Engenharia Eletrônica/2019
Assunto: Contadores e registradores
Considere o esquemático de circuito abaixo:
 
 
Esse esquemático representa:
 a) Um controlador de Registradores com Acumulação em buffer.
 b) Uma ULA completa.
 c) Um somador paralelo de 4 bits com don´t care sinalizável.
 d) Um buffer de 4 bits.
 e) Um somador completo de 4 bits completo com registradores.
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11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 20/58
Questão 861: COPEVE UFMG - Tec (UFMG)/UFMG/Eletroeletrônica/2019
Assunto: Contadores e registradores
Um microcontrolador com registradores de 8 bits executa a sequência de instruções a seguir:
 
MOV A,2Fh
MOV B,4Ah
MOV C,33h
ADD B
ORA C
 
Assinale a alternativa que mostra o conteúdo CORRETO do registrador A ao final da execução do código.
 a) ACh
 b) 79h
 c) 7Bh
 d) 2Fh
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Questão 862: SUGEP - Tec (UFRPE)/UFRPE/Laboratório/Eletrônica/2018
Assunto: Contadores e registradores
Observe o circuito lógico representado abaixo e assinale a alternativa incorreta.
 
 
 a) Trata-se de um registrador síncrono, porque os pulsos de clock (relógio) ativam todos os flip-flops simultaneamente.
 b) As entradas Reset e Load são assíncronas, pois independem do pulso de clock (relógio).
 c) O circuito pode operar com a entrada E e a saída QA, ambas seriais, sendo necessários 4 pulsos de clock (relógio) para se ter a informação desejada.
 d) O circuito opera como registrador série-paralelo ou como paralelo-série.
 e) É possível operar o circuito como um registrador paralelo-paralelo, necessitando de apenas um pulso de clock (relógio) para transmitir as entradas para as saídas.
 
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Questão 863: Instituto AOCP - Per (ITEP RN)/ITEP RN/Criminal/Engenharia Elétrica/2018
Assunto: Contadores e registradores
Ao analisar a Figura, um Engenheiro Eletricista constatou que essa figura mostra o diagrama de blocos de um
 
Figura: Diagrama.
 a) circuito integrado registrador de deslocamento de 8 bits com saídas tristate.
 b) Flip-flop JK síncrono.
 c) circuito integrado registrador de deslocamento de 16 bits multiplexado com saídas em coletor aberto.
 d) contador de década.
 e) circuito integrado de multiplex utilizado em comunicação de dados com tecnologia TTL família 54LS.
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Questão 864: CEBRASPE (CESPE) - OTI (ABIN)/ABIN/Área 6/2018
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 21/58
Assunto: Contadores e registradores
Em relação aos sistemas digitais, julgue o próximo item.
 
Nos contadores assíncronos, apesar da designação que recebem, as transições dos flip-flops são simultâneas.
 Certo
 Errado
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Questão 865: FUNDEP - Ana Tec (CODEMIG)/CODEMIG/Engenheiro de Instalações/2018
Assunto: Contadores e registradores
Analise o circuito a seguir.
A respeito desse circuito, é correto afirmar:
 a) O circuito é um contador assíncrono, de módulo 16, utilizando quatro flip-flop do tipo D com sinal de clock invertido.
 b) O circuito é um contador síncrono decádico, uma vez que todos os flip-flop recebem simultaneamente o sinal de clock.
 c) O início da contagem regressiva é selecionado aplicando-se nível 1 nas entradas J e K do flip-flop MSB.
 d) Um pulso de clear é aplicado simultaneamente em todos os flip-flop quando a contagem atinge o valor 1111 2.
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Questão 866: FCC - Eng (SABESP)/SABESP/Elétrica/2018
Assunto: Contadores e registradores
Considere um contador hipotético de 3 bits com entradas dadas por QA, QB e QC conforme a tabela verdade abaixo. Deseja-se obter a saída do referido contador para
realizar o acionamento de um comando.
 
QC QB QA Y
0 0 0 0
0 0 1 0
0 1 0 0
0 1 1 0
1 0 0 1
1 0 1 0
1 1 0 1
1 1 1 0
 
É correto afirmar que a equação mínima para a saída Y é:
 a) 
 b) 
 c) 
 d) 
 e) 
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Questão 867: FUMARC - Tec (CEMIG)/CEMIG/Telecomunicações I/2018
Assunto: Contadores e registradores
No circuito abaixo, o sinal C é a entrada de relógio (clock) e o conjunto Q0 e Q1 é a saída, sendo Q0 o seu bit menos significativo. Considerar que as entradas J e K dos
flip-flops estão permanentemente ligadas ao nível lógico alto.
Podemos afirmar que o circuito funciona como um contador assíncrono:
 
 QC QA
¯ ¯¯̄¯̄¯
. + +QB
¯ ¯¯̄¯̄¯
QA
¯ ¯¯̄¯̄¯
QB QA
+ .QC QC
¯ ¯¯̄¯̄
QA
+QC
¯ ¯¯̄¯̄
QA
¯ ¯¯̄¯̄¯
. +QC
¯ ¯¯̄¯̄
QA QA
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 22/58
 a) crescente módulo 2.
 b) crescente módulo 4.
 c) decrescente módulo 2.
 d) decrescente módulo 4.
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Questão 868: FUMARC - Eng (CEMIG)/CEMIG/Telecomunicações Jr/2018
Assunto: Contadores e registradores
No circuito abaixo, o sinal de entrada R fica em nível lógico ‘0’ por 10 ms após a energização do circuito, permanecendo após esse tempo em nível lógico ‘1’. O sinal de
entrada C, inicialmente em nível lógico‘0’, troca de valor a cada 50 ms. Decorridos 480 ms após a energização do circuito, o estado lógico do conjunto das saídas Q2, Q1
e Q0, nessa ordem, é:
 
 a) “001”
 b) “011”
 c) “100”
 d) “110”
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Questão 869: CESGRANRIO - Of (LIQUIGÁS)/LIQUIGÁS/Manutenção I/Eletrônica/2018
Assunto: Contadores e registradores
O circuito digital apresentado na Figura a seguir é utilizado para comandar a abertura e o fechamento da válvula V1, posicionada em um gasoduto por onde circula gás
natural. Esse circuito é composto por um contador binário de três bits, onde Y0 é o bit menos significativo, e Y2 é o mais significativo. O sinal de relógio CLK, que
determina a base de tempo do contador, também está ilustrado na Figura, onde o estado do contador em t = 0 é Y2Y1Y0 = 000.
 
 
Ao receber um sinal com nível lógico baixo, a válvula V1 é fechada, interrompendo a passagem de gás. Por outro lado, ao receber um sinal com nível lógico alto, a válvula
é aberta.
 
Dessa forma, qual o intervalo de tempo total, em minutos, em que a válvula V1 estará aberta entre os instantes t = 0 e t = 15 min?
 a) 3
 b) 4
 c) 6
 d) 8
 e) 10
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Questão 870: FUNDEP - Eng (INB)/INB/Eletricista/2018
Assunto: Contadores e registradores
Analise o funcionamento do circuito a seguir.
 
 
Após análise, identifica-se esse circuito como um:
 a) contador síncrono crescente de módulo 16.
 b) contador síncrono decrescente de módulo 16.
 c) registrador de entrada e saída paralela.
 d) registrador de entrada paralela / saída serial.
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Questão 871: FUNDEP - Tec (INB)/INB/Eletrônica/2018
Assunto: Contadores e registradores
Analise o diagrama do circuito a seguir.
 
 
Após análise, é correto afirmar que se trata de um:
 a) contador assíncrono de seis bits.
 b) contador síncrono de módulo 16.
 c) registrador de entrada paralela / saída paralela.
 d) registrador de entrada serial / saída paralela.
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Questão 872: CESGRANRIO - Eng (PETRO)/PETROBRAS/Equipamentos Júnior/Eletrônica/2018
Assunto: Contadores e registradores
Contadores são circuitos digitais amplamente utilizados para manipulação de dados e são construídos a partir da ligação de flip-flops em cascata. A Figura a seguir mostra
um exemplo de contador.
 
 
Em relação a contadores digitais, considere as afirmativas a seguir:
I - O contador assíncrono tem um sinal de clock único externo aplicado a todos os estágios ao mesmo tempo.
II - O valor máximo de contagens que um contador que utiliza 4 flip-flops pode atingir é 32.
III - É possível fazer a contagem de valores que não sejam potências de 2 combinando contadores comunscom portas lógicas conhecidas.
É(São) correta(s) APENAS a(s) afirmativa(s):
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 a) I
 b) II
 c) III
 d) I e II
 e) II e III
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Questão 873: CCV UFC - Tec (UFC)/UFC/Laboratório/Eletrônica/2018
Assunto: Contadores e registradores
Sobre o contador síncrono de flip-flops tipo JK representado na figura abaixo, considerando que o mesmo inicia-se com as saídas em 0, assinale a alternativa que contém
os estados de contagem C B A do respectivo contador.
 
 a) 2, 3, 4 e 8
 b) 4, 7, 5 e 8
 c) 0, 1, 2, 3 e 4
 d) 0, 1, 3, 7 e 6
 e) 0, 1, 3, 5, e 7
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Questão 874: SUGEP - Tec (UFRPE)/UFRPE/Laboratório/Eletrônica/2018
Assunto: Contadores e registradores
Com relação aos circuitos digitais contadores, assinale a alternativa incorreta.
 a) No contador assíncrono, os flip-flops são controlados por pulsos de relógio (clock) não simultâneos.
 b) No contador assíncrono, a saída de um flop-flop é ligada à entrada de relógio (clock) no flip-flop subsequente. Somente o primeiro flip-flop é controlado por
pulsos externos.
 c) É possível construir um contador hexadecimal assíncrono crescente. O mesmo circuito serve como contador hexadecimal assíncrono decrescente, bastando utilizar
as saídas complementares dos flip-flops.
 d) Para um contador assíncrono de 4 bits a frequência máxima do pulso de relógio (clock) deve ser menor que 4 vezes a frequência máxima de relógio (clock) de um
flip-flop.
 e) A frequência máxima de um flip-flop depende de sua fabricação, e seu valor é fornecido nas especificações técnicas pelo fabricante.
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Questão 875: FCC - Esp RT (ARTESP)/ARTESP/Engenharia Elétrica - Eletrônica/III/2017
Assunto: Contadores e registradores
Um contador assíncrono de cinco bits foi construído a partir de flip-flops J-K, que possuem os seguintes tempos, em nanossegundos, fornecidos pelo manual de seu
fabricante:
 
− High-to-Low Propagation Delay − tPHL (de CLK para Q) = 25
 
− Low-to-High Propagation Delay −tPLH (de CLK para Q) = 10
 
A frequência máxima de operação desse contador, considerando o pior caso é, em MHz:
 a) 5,7.
 b) 8,0.
 c) 10,0.
 d) 20,0.
 e) 25,0.
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Questão 876: COVEST-COPSET - Tec (UFPE)/UFPE/Eletroeletrônica/2017
Assunto: Contadores e registradores
O número mínimo de flip-flops do tipo D, necessário para implementar um contador que conta de zero até 72 é:
 a) 4
 b) 5
 c) 6
 d) 7
 e) 8
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Questão 877: FUNDEP - Tec (UFVJM)/UFVJM/Laboratório/Eletroeletrônica/2017
Assunto: Contadores e registradores
O CI 74ALS164 é um registrador de deslocamento à direita de 8 bits, com as entradas de dados, relógio, reset e saídas identificadas na tabela a seguir. Ambas entradas
de dados precisam estar em alto para entrar “1”.
 
 
No circuito apresentado, admitindo-se as saídas inicialmente zeradas, após 5 pulsos de relógio, o conteúdo das saídas Q7Q6Q5Q4Q3Q2Q1Q0 em hexadecimal é:
 a) 1F.
 b) F8.
 c) 07.
 d) 80.
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Questão 878: CEV UECE - Eng (FUNECE)/FUNECE/Eletricista/2017
Assunto: Contadores e registradores
Observe o seguinte circuito digital:
 
 
Esse circuito digital é um
 a) registrador de deslocamento de entrada série de 4 bits.
 b) contador assíncrono de 0 a 5.
 c) contador síncrono de 0 a 6.
 d) contador de década assíncrono.
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Questão 879: IBFC - Per Of (PCie PR)/PCie PR/Perito Criminal/Área 4/2017
Assunto: Contadores e registradores
Nos circuitos digitais, é comum o termo “Contadores”. Assinale a alternativa que define o termo em questão.
 a) São circuitos construídos a partir de AmpOp; eles garantem um estado fixo, sem a necessidade de um sinal clock
 b) São circuitos analógicos que garantem um estado fixo para um sistema digital
 c) São circuitos digitais que garantem um estado fixo, sem a necessidade de um clock
 d) São circuitos digitais que variam seus estados, sem a necessidade de um clock
 e) São circuitos digitais que variam seus estados, sob o comando de um clock, de acordo comuma sequência predeterminada
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Questão 880: FUNDEP - Tec (UFVJM)/UFVJM/Eletroeletrônica/2017
Assunto: Contadores e registradores
Analise o circuito, admitindo o uso de portas TTL e as saídas ABCD inicialmente zeradas.
 
 
Após 5 pulsos de relógio, o estado das saídas ABCD é igual a:
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 a) 1101
 b) 0101
 c) 1010
 d) 0011
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Questão 881: CONSULPLAN - TJ TRF2/TRF 2/Administrativa/Telecomunicações e Eletricidade/2017
Assunto: Contadores e registradores
Analise a figura que ilustra um circuito combinacional composto por flip-flops.
 
 
É correto afirmar que o circuito representa um:
 a) Contador em anel.
 b) Multiplex de 4 bits.
 c) Registrador de deslocamento.
 d) Divisor de frequência de 4 bits.
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Questão 882: CCV UFC - Eng (UFC)/UFC/Teleinformática/2017
Assunto: Contadores e registradores
No sexto pulso de clock, as saídas de um contador Johnson de 4-bits são Q0=0, Q1=0, Q2=1 e Q3=1. No sétimo pulso de clock, as saídas seriam:
 a) Q0=0, Q1=0, Q2=0 e Q3=0
 b) Q0=0, Q1=0, Q2=0 e Q3=1
 c) Q0=1, Q1=1, Q2=1 e Q3=0
 d) Q0=1, Q1=0, Q2=0 e Q3=1
 e) Q0=1, Q1=0, Q2=1 e Q3=1
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Questão 883: IBFC - Eng (EBSERH-HUGG)/EBSERH-HUGG/Eletricista/2017
Assunto: Contadores e registradores
Analise o circuito sequencial a seguir e assinale a alternativa em que momento a entrada Clear é utilizada para ajustar o sistema em seu reinício valendo Q1 = 0, Q2 = 0
e Q3 = 0.
 
 
 a) Quando Q1 = 1; Q2 = 1 e Q3 = 0
 b) Quando Q1 = 0; Q2 = 1 e Q3 = 0
 c) Quando Q1 = 1; Q2 = 0 e Q3 = 0
 d) Quando Q1 = 0; Q2 = 0 e Q3 = 1
 e) Quando Q1 = 1; Q2 = 1 e Q3 = 1
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Questão 884: COVEST-COPSET - Tec (UFPE)/UFPE/Eletrônica/2017
Assunto: Contadores e registradores
diagrama lógico a seguir representa um:
 
 
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 a) contador binário de 2 bits.
 b) contador assíncrono crescente.
 c) contador assíncrono decrescente.
 d) contador síncrono crescente.
 e) contador síncrono decrescente.
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Questão 885: COPEVE UFMG - Tec (UFMG)/UFMG/Laboratório/Eletrônica/2016
Assunto: Contadores e registradores
Um registrador de deslocamento em anel à esquerda de 8 bits apresenta o conteúdo 63H. Após receber três pulsos de relógio, o conteúdo CORRETO mostrado é:
 a) 6Ch.
 b) 1AH.
 c) 66H.
 d) 60H.
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Questão 886: COPEVE UFMG - Tec (UFMG)/UFMG/Laboratório/Eletrônica/2016
Assunto: Contadores e registradores
Considere a existência de três registradores em um CLP, denominados rA, rB e rC, cujos conteúdos iniciais sejam respectivamente C3H, 24H e 65H. Após a realização da
operação lógica (rB ← rA XOR rC), o conteúdo CORRETO de rB será:
 a) 24H.
 b) 28H.
 c) A6H.
 d) E7H.
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Questão 887: IBFC - Eng (SESA PR)/SESA PR/Eletricista/2016
Assunto: Contadores e registradores
A montagem a seguir, é típico do que se descreve na alternativa:
 
 a) Contador Hexadecimal síncrono.
 b) Contador Hexadecimal assíncrono.
 c) Latch (deslocamento) assíncrono.
 d) Latch (deslocamento) síncrono.
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Questão 888: Com. Org. (IFSP) - Tec (IF SP)/IF SP/Laboratório/Eletrônica/2016
Assunto: Contadores e registradores
Analisando o circuito da fi gura, formado por 4 fl ip-fl ops e assumindo inicialmente as seguintes condições:
• as saídas A, B, C e D iniciam com nível lógico zero;
• a entrada indicada como “Dados” permanece o tempo todo em nível lógico “1”.
Qual a quantidade de pulsos de Clock que são necessários para que a saída C assuma nível lógico “1”?
 
 
Figura acima – Registrador de deslocamento
 a) 1 pulso
 b) 2 pulsos
 c) 3 pulsos
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 28/58
 d) 4 pulsos
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Questão 889: Com. Org. (IFSP) - Tec (IF SP)/IF SP/Laboratório/Eletrônica/2016
Assunto: Contadores e registradores
O circuito da figura corresponde a um contador assíncrono.
 
 
Figura acima – Contador assíncrono
As saídas A, B e C são responsáveis por indicar a contagem binária, sendo a saída A referente ao bit menos significativo. As saídas B e C são também conectadas às
entradas da porta NAND.
Assumindo que inicialmente que as saídas C, B e A estão com valor binário 000, ou seja, C=0, B=0 e A=0, qual o valor binário presente nessas saídas após 10 pulsos de
clock?
 a) 011
 b) 010
 c) 111
 d) 100
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Questão 890: DIRPS UFU - Tec (UFU)/UFU/Eletrônica/2016
Assunto: Contadores e registradores
O registrador A é de 4 bits e possui valor inicial de 1111b. Adicionando-se o valor 0001b ao registrador A, o resultado é:
 a) 
 b) 
 c) 
 d) 
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Questão 891: DIRPS UFU - Tec (UFU)/UFU/Eletrônica/2016
Assunto: Contadores e registradores
A figura abaixo mostra um esquema de um contador síncrono, utilizado em sistemas de acionamento de motores de passo.
 
 
Sabe-se que a entrada Direção se encontra em nível lógico baixo.
 
 
Assinale a alternativa que apresenta a sequência que completa corretamente a tabela acima, na ordem BA.
 a) 10, 11, 01, 00.
 b) 11, 01, 10, 00.
 c) 01, 11, 10, 00.
 d) 01, 10, 11, 00.
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Questão 892: CCC IFCE - Tec (IF CE)/IF CE/Eletrotécnica/2016
0000b
1110b
1000b
1101b
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 29/58
Assunto: Contadores e registradores
O circuito mostrado na figura abaixo é um contador binário
 a) assíncrono de 0 a 4.
 b) sequencial de 0 a 5.
 c) síncrono de 0 a 2.
 d) síncrono gerador de código binário de 3 bits.
 e) ondulante de 0 a 7.
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Questão 893: FAURGS - Tec (UFRGS)/UFRGS/Eletrônica/2016
Assunto: Contadores e registradores
Observe a figura abaixo.
 
 
No circuito acima, com componentes ideais, considere que as saídas Q1 e Q2 dos Flip-Flops FF1 e FF2 estão em valor lógico zero (0 lógico) antes de ser aplicado o sinal
de relógio “CLK”. Após o início da aplicação do relógio, os sinais SET e CLEAR permanecem com valor lógico um (1 lógico). As saídas Q1, Q2, D1 e D2 assumem,
respectivamente, os seguintes valores a cada pulso de relógio:
 a) 0000, 0110, 1001, 0110, 1001, 0110, 1001, ...
 b) 0000, 0110, 1011, 0110, 1011, 0110, 1011, ...
 c) 0001, 0110, 1000, 0110, 1000, 0110, 1000, ...
 d) 0001, 0110, 1001, 0110, 1001, 0110, 1001, ...
 e) 0011, 0110, 1011, 0110, 1011, 0110, 1011, ...
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Questão 894: FUNDEP- Tec (IFNMG)/IFNMG/Eletrotécnica/2016
Assunto: Contadores e registradores
Analise o circuito a seguir, considerando que todas as entradas J e K estão em nível 1.
 
 
 
 
Com relação ao funcionamento desse circuito, é correto afirmar:
 a) A cada pulso de CLOCK, os flip-flop JK alternam, simultaneamente, sua saída na borda de subida do pulso de CLOCK.
 b) A saída B apresenta um glitch provocado pela ocorrência do estado “110”, produzindo um flash no LED ou display nela conectada.
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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 c) O contador vai ao estado temporário “000” permanecendo nessa condição durante dois ciclos completos do CLOCK.
 d) Um contador de módulo 6 é obtido pelo acionamento do CLEAR de um contador de módulo 8, quando a contagem atinge o número seis.
 
 
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Questão 895: COPEVE UFMG - Eng (UFMG)/UFMG/Eletricista/2016
Assunto: Contadores e registradores
Um contador assíncrono crescente de três bits possui as saídas Q0, Q1 e Q2, sendo que Q0 representa o bit menos significativo (LSB) e Q2 representa o bit mais
significativo (MSB). Se o contador recebe pulsos de um sinal quadrado na entrada de clock do flip-flop gerador do bit Q0 a uma frequência de 10 MHz, é CORRETO
afirmar que a frequência de saída do sinal em Q2 será
 a) 1,25 MHz.
 b) 3,33 MHz.
 c) 2,50 MHz.
 d) 1,67 MHz.
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Questão 896: FUNDEP - Sold (CBM MG)/CBM MG/Técnico em Eletrotécnica/2016
Assunto: Contadores e registradores
Observe o circuito e o diagrama de temporização a seguir.
 
 
Com relação ao funcionamento desse circuito, é CORRETO afirmar:
 a) A cada pulso na entrada CK, todos os biestáveis do circuito chavearão a saída de “0” para “1”.
 b) O circuito representa um contador assíncrono de 4 bits, de módulo 16, utilizando biestáveis JK.
 c) O circuito representa um contador síncrono de 4 bits, de módulo 8, utilizando biestáveis JK.
 d) O círculo na entrada CK do biestável RS significa que a unidade chaveará na transição de bordo anterior.
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Questão 897: COPEVE UFMG - Tec (UFMG)/UFMG/Laboratório/Eletrônica/2016
Assunto: Contadores e registradores
A figura abaixo mostra o diagrama lógico do 74LS90, circuito integrado comercial de tecnologia TTL amplamente utilizado como contador de década ou divisor de
frequência.
 
 
Pela análise do circuito, é correto afirmar, EXCETO:
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 a) é um contador assíncrono.
 b) é um contador síncrono.
 c) é constituído por um contador módulo 2 e outro módulo 5.
 d) o relógio é ativo na borda de descida.
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Questão 898: FGV - Ass SG (COMPESA)/COMPESA/Técnico Operacional/Habilitação em Eletrônica/2016
Assunto: Contadores e registradores
A figura a seguir mostra uma transferência serial de dados por meio de um registrador de deslocamento.
 
 
Assinale a opção que indica o diagrama de tempo para a saída S.
 a) 
 
 
 b) 
 
 
 c) 
 
 
 d) 
 
 
 e) 
 
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Questão 899: COPERVE-UFSC - Tec (UFSC)/UFSC/Eletrônica/2016
Assunto: Contadores e registradores
Assinale a alternativa que indica CORRETAMENTE a faixa de endereços (em hexadecimal) que permite ao micro controlador escrever nos registradores.
 
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 32/58
 
 a) 0xF8 a 0xFF
 b) 0xCC a 0xCF
 c) 0xF0 a 0xF7
 d) 0xFC a 0xFF
 e) 0xF8 a 0xFC
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Questão 900: COPERVE-UFSC - Tec (UFSC)/UFSC/Eletrônica/2016
Assunto: Contadores e registradores
Considerando que o atraso de propagação do circuito seja nulo e que as saídas sejam inicializadas com A = 1, B = 1 e C = 0, assinale a alternativa que apresenta
CORRETAMENTE os valores assumidos por essas saídas após o terceiro pulso de clock.
 
 
 a) A = 0, B = 1 e C = 1
 b) A = 0, B = 0 e C = 1
 c) A = 1, B = 1 e C = 0
 d) A = 0, B = 0 e C = 0
 e) A = 1, B = 0 e C = 0
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Questão 901: IBFC - Eng (EBSERH-HUAP)/EBSERH-HUAP/Eletricista/2016
Assunto: Contadores e registradores
Avalie a montagem a seguir e atribua respectivamente V (verdadeiro) ou F (falso) às afirmações que seguem.
 
 
( ) Esta montagem trata de um contador assíncrono.
 
( ) Para transformarmos a montagem em um contador decrescente basta utilizarmos a saída Q barrada.
 
( ) Neste tipo de contador o atraso não depende do número de bits, mas apenas da tecnologia utilizada. Por outro lado, como o atraso de propagação é menor, o
contador síncrono pode trabalhar com frequências maiores que o contador assíncrono.
 
 a) V, V e V
 b) F, V e F
 c) V, F e V
 d) F, V e V
 e) V, V e F
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Questão 902: FCM - CEFETMINAS - Tec (IF RJ)/IF RJ/Laboratório/Eletrotécnica - Eletrônica - Instrumentação/2016
Assunto: Contadores e registradores
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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Analise os diagramas esquemáticos e de tempo abaixo.
 
 
O circuito é um
 a) registrador de deslocamento com entrada e saída seriais – SISO.
 b) contador Johnson, utilizando a saída invertida do último flipflop, tipo D.
 c) contador em anel de 4 bits, de módulo 4, utilizando três flipflop, tipo JK.
 d) contador crescente/decrescente síncrono, definido pelo estado lógico do sinal de controle.
 e) contador assíncrono ondulante de 4 bits com o clock atuando sobre todos os flip-flop.
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Questão 903: SUGEP - Tec (UFRPE)/UFRPE/Laboratório/Eletrônica/2016
Assunto: Contadores e registradores
Considerando os contadores formados basicamente por flip-flops, analise as seguintes afirmações.
 
1) Contador fornece em suas saídas um conjunto de níveis lógicos numa sequência predeterminada.
2) A velocidade da sequência gerada é determinada pela frequência dos pulsos de clock apenas para o flip-flop síncrono, já que no assíncrono não há o clock.
3) Pode-se construir um contador crescente ou decrescente, seja ele síncrono ou assíncrono.
4) Um contador pode ser construído para contar numa sequência qualquer.
 
Estão corretas:
 a) 1, 2 e 4, apenas.
 b) 1 e 3, apenas.
 c) 2 e 3, apenas.
 d) 1, 2, 3 e 4.
 e) 1, 3 e 4, apenas.
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Questão 904: CCC IFCE - Tec (IF CE)/IF CE/Laboratório/Eletrotécnica/2016
Assunto: Contadores e registradores
O circuito mostrado na figura é um contador binário
 a) assíncrono de 0 a 2.
 b) sequencial de 0 a 3.
 c) síncrono de 0 a 6.
 d) síncrono gerador de código binário de 3 bits.
 e) ondulante de 0 a 7.
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Questão 905: CCC IFCE - Tec (IF CE)/IF CE/Laboratório/Indústria Elétrica/2016
Assunto: Contadores e registradores
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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O circuito mostradona figura abaixo é um contador binário
 a) ondulante de 0 a 7.
 b) sequencial de 0 a 4.
 c) síncrono de 0 a 6.
 d) síncrono gerador de código binário de 3 bits.
 e) assíncrono de 0 a 5.
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Questão 906: FCC - ADP (DPE SP)/DPE SP/Engenheiro Elétrico/2015
Assunto: Contadores e registradores
A denominação do circuito integrado 74LS373, de acordo com os fabricantes, é 3-STATE Octal D-Type Transparent Latches and Edge-Triggered Flip-Flops.
Portanto, trata-se de um
 a) comparador de oito bits, gatilhavel.
 b) registrador de deslocamento circular com Flip-Flop JK − MS.
 c) subtrator de oito bits com saída em alta impedância.
 d) registrador de oito bits acionado pela transição do pulso de relógio e com saída em alta impedância.
 e) contador CMOS com registrador de deslocamento e saída tri-state.
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Questão 907: VUNESP - Ass TM (Pref SJC)/Pref SJC/Técnico em Elétrica/2015
Assunto: Contadores e registradores
Deseja-se projetar um contador síncrono binário módulo-8 utilizando-se como elementos de memória apenas flip-flops D sensíveis à borda.
 
O número mínimo de flip-flops que serão necessários nesse circuito é
 a) 1.
 b) 2.
 c) 3.
 d) 5.
 e) 8.
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Questão 908: COVEST-COPSET - Tec (UFPE)/UFPE/Eletrônica/2015
Assunto: Contadores e registradores
O circuito digital abaixo é um:
 
 
 a) Contador BCD assíncrono
 b) Contador binário síncrono
 c) Contador BCD síncrono
 d) Contador binário assíncrono
 e) Contador crescente/decrescente
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Questão 909: CS UFG - Eng Ele (IF GOIANO)/IF GOIANO/2014
Assunto: Contadores e registradores
A figura a seguir representa um contador assíncrono de 4 bits e com saída QD, QC, QB e QA.
 
 
O contador mostrado na figura é denominado de módulo
 a) 4
 b) 8
 c) 12
 d) 16
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Questão 910: IF RS - Téc (IF RS)/IF RS/Laboratório/Eletrônica/2014
Assunto: Contadores e registradores
O circuito 74LS93, cujo esquemático pode ser visto abaixo, é um circuito integrado que permite a implementação de contadores assíncronos. Num experimento
laboratorial, pretende-se implementar um contador de década usando esse circuito (desprezando eventuais glitches). Considerando as opções abaixo e sabendo que o
circuito já está corretamente alimentado e que existe uma fonte externa de sincronismo (chamada CLOCK), assinale a alternativa CORRETA correspondendo à conexão
adequada dos sinais para implementar o contador pretendido:
 
 
 a) CLKA ligado no CLOCK externo, CLKB ligado em Q0, MR1 ligado em Q0 e MR2 ligado em Q3.
 b) CLKA ligado no CLOCK externo, CLKB ligado em Q0, MR1 ligado em Q1 e MR2 ligado em Q3.
 c) CLKA ligado em Q0, CLKB ligado no CLOCK externo, MR1 ligado em Q1 e MR2 ligado em Q3.
 d) CLKA ligado em Q0, CLKB ligado no CLOCK externo, MR1 ligado em Q0 e MR2 ligado em Q3.
 e) CLKA ligado no CLOCK externo, CLKB ligado em Q0, MR1 ligado em Q2 e MR2 ligado em Q3.
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Questão 911: FGV - Ana San (COMPESA)/COMPESA/Engenheiro Eletrônico/2014
Assunto: Contadores e registradores
A implementação abaixo utiliza um contador de 4 bits e um somador de duas entradas de 4 bits sem carry de entrada. Para as entradas e as saídas do contador e do
somador, índice 0 representa o bit menos significativo e o índice 3 representa o bit mais significativo.O valor das linhas ABCD é 1010. Após ser inicializado pelo valor das
linhas, conforme a figura, o contador inicia a contagem no sentido crescente.
 
 
Considerando que todos os valores são atualizados instantaneamente, após a terceira borda de subida do sinal de clk (onda quadrada), os valores de Co (carry out) e de
S0-S1-S2-S3, respectivamente, são
 a) Co = 0 S0 S1 S2 S3= 0101
 b) Co = 0 S0 S1 S2 S3= 0011
 c) Co = 0 S0 S1 S2 S3= 1011
 d) Co = 1 S0 S1 S2 S3= 0101
 e) Co = 1 S0 S1 S2 S3= 0000
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11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
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Questão 912: COPEVE (UFAL) - Eng (ALGÁS)/ALGÁS/Elétrica/2014
Assunto: Contadores e registradores
Analisando-se as seguintes afirmativas, sobre os registradores de deslocamento,
 
I. São utilizados para transferência de dados nos modos entrada série/saída série e entrada paralela/saída paralela.
 
II. Sua função principal é armazenar dados, operando como memória.
 
III. Somente podem ser construídos com flip-flops tipo D.
 
IV. Uma limitação dos registradores de deslocamento é a impossibilidade de operar como contadores.
 
verifica-se que está(ão) correta(s) apenas
 a) I.
 b) II.
 c) II e IV.
 d) I, III e IV.
 e) II, III e IV.
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Questão 913: COPERVE-UFSC - Tec (UFSC)/UFSC/Eletrônica/2014
Assunto: Contadores e registradores
A figura a seguir apresenta o diagrama esquemático de um circuito sequencial.
 
 
O diagrama esquemático representa um circuito contador de quatro bits. Considerando que o circuito possui um sinal de relógio na entrada clock, que as entradas set e
clr dos flip-flops estão desativadas, ou seja, o circuito está habilitado para realizar uma contagem, e que o valor inicial em é 1 (em decimal), assinale a
alternativa que apresenta a sequência CORRETA de valores, em decimal, fornecida nas saídas do circuito para os primeiros dez pulsos do sinal de
relógio na entrada clock.
 
 a) 1 – 2 – 4 – 9 – 3 – 6 – 13 – 10 – 5 – 11 – 7
 b) 1 – 3 – 5 – 8 – 4 – 2 – 11 – 12 – 9 – 13 – 6
 c) 1 – 4 – 7 – 8 – 3 – 2 – 10 – 11 – 6 – 12 – 5
 d) 1 – 4 – 9 – 7 – 3 – 6 – 12 – 11 – 2 – 10 – 5
 e) 1 – 6 – 4 – 8 – 3 – 7 – 12 – 13 – 2 – 11 – 5
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Questão 914: CONSULPLAN - ANT (CBTU)/CBTU/Engenheiro Eletrônico/2014
Assunto: Contadores e registradores
Analise a figura a seguir.
 
 
Contadores assíncronos são circuitos digitais que variam os seus estados, de acordo com a variação de um sinal de clock. De acordo com o circuito apresentado, o valor
de frequência na saída D é igual a
 a) 4 kHz.
 b) 4.285 kHz.
 c) 4.615 kHz.
 d) 5.454 kHz.
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Q3Q2Q1Q0
Q3Q2Q1Q0
11/03/2020 TEC Concursos - Questões para concursos, provas, editais, simulados.
https://www.tecconcursos.com.br/questoes/cadernos/experimental/15976689/imprimir 37/58
Questão 915: CEBRASPE (CESPE) - AJ (TJ SE)/TJ SE/Apoio Especializado/Engenharia Elétrica/2014
Assunto: Contadores e registradores
Julgue o item a seguir, relativo à organização dos computadores modernos.
 
Em uma arquitetura computacional, o modo de endereçamento em bytes exige que o conteúdo de dados alocados nos registradores seja, obrigatoriamente, múltiplo de 8
bits.
 Certo
 Errado
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Questão 916: CEBRASPE (CESPE) - AJ (TJ SE)/TJ SE/Apoio Especializado/Engenharia Elétrica/2014
Assunto: Contadores e registradores
Julgue o item a seguir, relativo à organização dos computadores modernos.
 
Mediante a unidade lógica aritmética (ULA), realizam-se operações única e exclusivamente entre os conteúdos de registradores, independentemente